| Name | mps-v2-13-7/ftp.netlib.org/lp/data/normalized-mps-v2-13-7-sc105.opb |
| MD5SUM | c822b1c022f6bb2b01940173213da6e2 |
| Bench Category | optimization, medium integers (OPTMEDINT) |
| Has Objective Function | YES |
| Satisfiable | YES |
| (Un)Satisfiability was proved | YES |
| Best value of the objective function | 0 |
| Optimality of the best value was proved | YES |
| Number of terms in the objective function | 20 |
| Biggest coefficient in the objective function | 524288 |
| Number of bits for the biggest coefficient in the objective function | 20 |
| Sum of the numbers in the objective function | 1048575 |
| Number of bits of the sum of numbers in the objective function | 20 |
| Biggest number in a constraint | 8388608 |
| Number of bits of the biggest number in a constraint | 24 |
| Biggest sum of numbers in a constraint | 22020075 |
| Number of bits of the biggest sum of numbers | 25 |
| Best result obtained on this benchmark | OPTIMUM FOUND |
| Best CPU time to get the best result obtained on this benchmark | 6.36803 |
| Number of variables | 2060 |
| Total number of constraints | 104 |
| Number of constraints which are clauses | 0 |
| Number of constraints which are cardinality constraints (but not clauses) | 0 |
| Number of constraints which are nor clauses,nor cardinality constraints | 104 |
| Minimum length of a constraint | 40 |
| Maximum length of a constraint | 80 |
LAUNCH ON wulflinc5 THE 2005-09-19 22:24:10 (client local time) PB2005-SCRIPT v4.0 MARKUPS: idlaunch=837 boxname=wulflinc5 idbench=837 idsolver=1 numberseed=0 MD5SUM SOLVER: 38f99674050b34630888bf623b924b59 /oldhome/oroussel/solvers/bsolo MD5SUM BENCH: c822b1c022f6bb2b01940173213da6e2 /oldhome/oroussel/tmp/wulflinc5/normalized-mps-v2-13-7-sc105.opb REAL COMMAND: bsolo /oldhome/oroussel/tmp/wulflinc5/normalized-mps-v2-13-7-sc105.opb IDLAUNCH: 837 /proc/cpuinfo: processor : 0 vendor_id : GenuineIntel cpu family : 6 model : 7 model name : Pentium III (Katmai) stepping : 2 cpu MHz : 451.007 cache size : 512 KB fdiv_bug : no hlt_bug : no f00f_bug : no coma_bug : no fpu : yes fpu_exception : yes cpuid level : 2 wp : yes flags : fpu vme de pse tsc msr pae mce cx8 apic sep mtrr pge mca cmov pat pse36 mmx fxsr sse bogomips : 888.83 processor : 1 vendor_id : GenuineIntel cpu family : 6 model : 7 model name : Pentium III (Katmai) stepping : 2 cpu MHz : 451.007 cache size : 512 KB fdiv_bug : no hlt_bug : no f00f_bug : no coma_bug : no fpu : yes fpu_exception : yes cpuid level : 2 wp : yes flags : fpu vme de pse tsc msr pae mce cx8 apic sep mtrr pge mca cmov pat pse36 mmx fxsr sse bogomips : 899.07 /proc/meminfo: MemTotal: 1034660 kB MemFree: 918220 kB Buffers: 14984 kB Cached: 76756 kB SwapCached: 740 kB Active: 33240 kB Inactive: 61200 kB HighTotal: 131008 kB HighFree: 50120 kB LowTotal: 903652 kB LowFree: 868100 kB SwapTotal: 2097136 kB SwapFree: 2095892 kB Dirty: 28 kB Writeback: 0 kB Mapped: 5804 kB Slab: 16244 kB Committed_AS: 64264 kB PageTables: 332 kB VmallocTotal: 114680 kB VmallocUsed: 1364 kB VmallocChunk: 113256 kB JOB ENDED THE 2005-09-19 22:31:28 (client local time) WITH STATUS 30 IN 427.438 SECONDS stats: 837 0 427.438 30
c INFO: OSL Context initialized. c Initial problem consists of 2060 variables and 149 constraints. c No problem reductions applied in OPT. instance. c preprocess terminated. Elapsed time: 0.649 c After prepocess the problem consists of 1824 variables and 149 constraints. c Initial Lower Bound: -16383 c Restart #1 #Var: 1824 #Dec: 5134 LB: -16383 @ 1.36 c Restart #2 #Var: 1824 #Dec: 11100 LB: -16383 @ 2.803 c Restart #3 #Var: 1824 #Dec: 22709 LB: -16383 @ 6.535 c Restart #4 #Var: 1824 #Dec: 47625 LB: -16383 @ 9.681 c Restart #5 #Var: 1824 #Dec: 76561 LB: -16383 @ 12.125 c Restart #6 #Var: 1824 #Dec: 98659 LB: -16383 @ 13.995 c Restart #7 #Var: 1824 #Dec: 102532 LB: -16383 @ 14.867 c Restart #8 #Var: 1824 #Dec: 104159 LB: -16383 @ 16.918 c Restart #9 #Var: 1824 #Dec: 106111 LB: -16383 @ 19.728 c Restart #10 #Var: 1824 #Dec: 108117 LB: -16383 @ 22.268 c Restart #11 #Var: 1824 #Dec: 110599 LB: -16383 @ 25.665 c Restart #12 #Var: 1824 #Dec: 113014 LB: -16383 @ 28.874 c Restart #13 #Var: 1824 #Dec: 115798 LB: -16383 @ 33.078 c Restart #14 #Var: 1824 #Dec: 118610 LB: -16383 @ 37.049 c Restart #15 #Var: 1824 #Dec: 121759 LB: -16383 @ 41.462 c Restart #16 #Var: 1824 #Dec: 125017 LB: -16383 @ 46.819 c Restart #17 #Var: 1824 #Dec: 128431 LB: -16383 @ 52.145 c Restart #18 #Var: 1824 #Dec: 132055 LB: -16383 @ 57.341 c Restart #19 #Var: 1824 #Dec: 136070 LB: -16383 @ 62.757 c Restart #20 #Var: 1824 #Dec: 141062 LB: -16383 @ 69.932 c Restart #21 #Var: 1824 #Dec: 145272 LB: -16383 @ 75.819 c Restart #22 #Var: 1816 #Dec: 149702 LB: -8191 @ 81.464 c Restart #23 #Var: 1816 #Dec: 154311 LB: -8191 @ 86.187 c Restart #24 #Var: 1812 #Dec: 159174 LB: -8191 @ 92.122 c Restart #25 #Var: 1812 #Dec: 164183 LB: -8191 @ 97.238 c Restart #26 #Var: 1812 #Dec: 169394 LB: -8191 @ 104.08 c Restart #27 #Var: 1812 #Dec: 174805 LB: -8191 @ 110.03 c Restart #28 #Var: 1812 #Dec: 180419 LB: -8191 @ 117.27 c Restart #29 #Var: 1812 #Dec: 186232 LB: -8191 @ 124.78 c Restart #30 #Var: 1812 #Dec: 192243 LB: -8191 @ 131.93 c Restart #31 #Var: 1812 #Dec: 198455 LB: -8191 @ 140.35 c Restart #32 #Var: 1812 #Dec: 204865 LB: -8191 @ 147.94 c Restart #33 #Var: 1812 #Dec: 211474 LB: -8191 @ 156.42 c Restart #34 #Var: 1812 #Dec: 218286 LB: -8191 @ 165.17 c Restart #35 #Var: 1812 #Dec: 225298 LB: -8191 @ 173.38 c Restart #36 #Var: 1812 #Dec: 232506 LB: -8191 @ 181.46 c Restart #37 #Var: 1812 #Dec: 241067 LB: -8191 @ 191.91 c Restart #38 #Var: 1784 #Dec: 250778 LB: -8191 @ 240.71 c NEW SOLUTION FOUND: 0 @ 273.52 @ #Dec. 257733 c Restart #39 #Var: 1784 #Dec: 266052 LB: -8191 @ 278.08 c Restart #40 #Var: 1783 #Dec: 274095 LB: -8191 @ 282.13 c Restart #41 #Var: 1761 #Dec: 285933 LB: -8191 @ 384.18 s OPTIMUM FOUND v -COL00004_bit_7 -COL00004_bit_6 -COL00004_bit_5 -COL00004_bit_4 -COL00004_bit_3 -COL00004_bit_2 -COL00004_bit_1 -COL00004_bit0 -COL00004_bit1 -COL00004_bit2 -COL00004_bit3 -COL00004_bit4 -COL00004_bit5 -COL00004_bit6 -COL00004_bit7 -COL00004_bit8 -COL00004_bit9 -COL00004_bit10 -COL00004_bit11 -COL00004_bit12 COL00001_bit_7 COL00001_bit_6 -COL00001_bit_5 COL00001_bit_4 -COL00001_bit_3 -COL00001_bit_2 -COL00001_bit_1 -COL00001_bit0 -COL00001_bit1 COL00001_bit2 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